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first_img サムスン電子は、HBM4の需要に対応するために4ナノメートルの生産を拡大する計画です。

Money Todayの9月21日の報道によると、サムスン電子はHBM市場の成長に伴い、ウェハー代工の先進プロセス能力の拡張を進めており、HBM4基座チップの需要増加に対応するために4nmプロセスの増産を検討しています。サムスンのHBM4は、10nm世代の6世代(1c)DRAMコアチップと4nmロジック基座チップで構成されており、基座チップはGPUなどのAIアクセラレーターとの高速データ交換を担当しています。SKハイニックスがTSMCの12nmを採用しているのとは異なり、サムスンはHBM4基座チップに自社の4nmプロセスを使用しています。この生産ラインはフル稼働しており、NVIDIAのGroq 3 LPUなどの注文を受けています。最近、会社は4nmの新しい注文とHBM4基座チップの価格を引き上げました。サムスンは第3四半期のHBM4の収益が前四半期比で3倍以上増加すると予想しており、下半期のHBM収益におけるHBM4の割合は60%以上になる見込みです。平沢P4の追加増産の大部分はHBM用の1c DRAMに使用され、ウェハー代工の4nm能力の半分以上がHBM4基座チップに割り当てられています。HBM4Eも同様に4nm基座チップを採用しており、サムスンは5月に顧客にサンプルを提供しました。会社はまた、HBM5のために2nmの新しい生産ラインを構築することを検討しており、GAA構造の2nmプロセスを目指し、TSV密度を向上させ、HBM4Eに比べて動作速度を50%以上向上させることを目指しています。サムスンは昨年の下半期に2nmの第一世代量産を開始し、今年の下半期には第二世代製品を推進します。シティは来年の世界のHBMビット需要が752億Gbに達し、前年比62%増加すると予測しており、供給は約594億Gb、ギャップは約21%になるとしています。

first_img サムスン 4 ナノメートルの過半の生産能力が HBM4 基底チップに使用される

三星電子のウェハ受託製造部門は、4ナノプロセスにおいて、第6世代高帯域幅メモリHBM4用の基板チップの量産比率が最近50%を突破したと発表しました。業界では、この部門が今年下半期に4ナノウェハの半分以上をHBM4基板チップの製造に投入する見込みで、NVIDIA、Broadcom、AMDなどへの供給を拡大する計画です。三星は今年2月にHBM4の量産出荷を開始し、第三四半期から供給量を拡大する予定で、年の中頃から関連ウェハの投入を大幅に増加させる計画です。このチップは三星のウェハ受託製造4ナノ(SF4)プロセスに基づいています。先月までに、全ての4ナノ生産能力の50%以上がHBM4基板チップに割り当てられました。関係者によると、三星の4ナノは現在フル稼働しており、その中でHBM4基板チップの割合は約50%から60%であり、下半期も高い割合を維持する見込みです。三星は平沢の2工場と3工場で4ナノから7ナノ級のプロセスを量産しており、4ナノの生産能力は月に約3万枚です。これに基づくと、HBM4基板チップ関連のウェハ投入は月に約1.5万枚と推定されます。三星は第二四半期の業績電話会議で、第三四半期のHBM4収益が前四半期比で3倍以上に拡大する見込みであり、下半期のHBM4収益は会社全体のHBM収益の60%を超えると予想しています。

first_img 三星はNVIDIA向けにカスタムNVHBMを開発し、8層の高速HBM4Eを推進しています。

ソウル経済の報道によると、サムスン電子は、NVIDIAの要求に応じたHBM4E(第7世代)8層製品を開発しており、カスタム高帯域幅メモリNVHBMの供給の核心パートナーとしての地位を確保しようとしています。この製品は、当初計画されていた12層、16層よりもスタッキングの高さを低くし、NVIDIAが提案した速度仕様は17-18Gbpsで、サムスンの初期HBM4Eサンプルの速度(14.4Gbps)より約20%高く、NVIDIAが公開したNVLink最適化仕様のNVHBMに使用されます。8層を採用することで、従来のスタッキング層数を増やして容量を向上させるHBMとの競争ロジックとは逆に、後工程の難易度と歩留まりの圧力を低下させ、供給の拡大に寄与し、NVIDIAがメモリ不足を緩和する戦略と見なされています。NVHBMは、来年発売予定の次世代AI GPU「Rubin Ultra」からの適用が期待されており、このGPUはGPU間の接続規模を72から576に拡大し、より高速なHBMを搭載した数百のGPUが協調して全体の計算能力を向上させます。カスタムHBM市場において、サムスンはSKハイニックスやマイクロンに比べて競争力があり、NVHBMにはDRAMとロジックチップベースの基裸片設計生産能力が必要であり、サムスンは一体的に対応できます。業界関係者によると、サムスンはHBM4で業界最高水準の速度を検証しており、速度競争において優位性を発揮できるとされています。

hot_img 英偉達のヴェラ・ルービンプラットフォームのメモリコスト比率が62%に上昇し、SOCAMM2が主要なドライバーとなる。

スイス銀行によるVera Rubin超チップの部品表(BOM)の分析によると、メモリ半導体はこのプラットフォームの総コストにおいて約62%を占めており、前世代のBlackwell Ultra(GB300)の53%から大幅に増加しています。Vera Rubin超チップ(1つのVera CPUと2つのRubin GPUを含む)の総コストは約38,902ドルで、そのうちメモリ関連コストは24,297ドルに達しています。HBM4のコストは約4,943ドル(総コストの12.7%を占め)、CPUに接続されるSOCAMM2のコストは約19,355ドル(総コストの49.8%を占め)、メモリコスト上昇の主要な要因となっています。SOCAMM2は低消費電力DRAM LPDDR5Xに基づくサーバーメモリモジュールで、単一CPUで最大1.5TBの容量をサポートします。Vera Rubin NVL72キャビネット(72個のRubin GPUと36個のVera CPUを含む)は合計74.7TBのDRAMを搭載しており、そのうちHBM4は20.7TB、CPU用のLPDDR5Xは54TBです。単一キャビネットのLPDDR使用量は約4,500台の高性能スマートフォンに相当します。しかし、LPDDR5XおよびHBM4Eの供給不確実性の影響を受けて、NVIDIAは次世代Rubin UltraのHBM構成を引き下げることを検討しています。

hot_img サムスン電子Q2 売上高 171.5兆ウォンの新記録、営業利益 89.5兆ウォンが前年同期比で1813%増加

サムスン電子は2026年第2四半期の財務報告を発表し、売上高は 171.5兆 ウォン(約 1188億ドル )で、前年同期比 130% 、前四半期比 28% の増加となり、単四半期の歴史的最高値を記録しました;営業利益は 89.5兆 ウォン(約 620億ドル )で、前年同期比 1813.8% 、前四半期比 56.4% の増加となり、市場予想を約 5% 上回りました;純利益は 71.62兆 ウォン(約 496億ドル )で、前年同期比 1299.9% の急増となりました。1株当たり利益は 10849ウォン で、前年同期比 52% の増加です。デバイスソリューション(DS)部門の売上高は 127.5兆 ウォン、営業利益は 89.2兆 ウォンで、前四半期比 56% の増加となり、メモリ事業はAIサーバーの需要に支えられ、売上高と利益はともに歴史的最高値を記録しました。HBM4 は量産出荷され、HBM4E サンプルは主要顧客に納品されました。デバイス体験(DX)部門の売上高は前四半期比 9% 減少し、その中でMX事業は部品コストの圧力の影響を受け、売上高は 33.2兆 ウォンで、営業損失は 0.7兆 ウォンを記録しました。サムスンは下半期にサーバーDRAM、eSSDおよびHBMの需要が引き続き強力であると予測しており、市場供給のひっ迫した状況が続くと見込んでいますが、モバイルおよびPC端の需要は一部減速する可能性があります。会社はHBM4、DDR5、SOCAMM2などの高付加価値製品の販売を拡大し、第二世代 2nm プロセスで新しいモバイル製品を量産し、受託生産事業の二桁の売上成長を目指します。
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